/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (c) 2024 Samsung Electronics Co., Ltd. * Author: Sunyeal Hong * * Device Tree binding constants for ExynosAuto v920 clock controller. */ #ifndef _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H #define _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H /* CMU_TOP */ #define FOUT_SHARED0_PLL 1 #define FOUT_SHARED1_PLL 2 #define FOUT_SHARED2_PLL 3 #define FOUT_SHARED3_PLL 4 #define FOUT_SHARED4_PLL 5 #define FOUT_SHARED5_PLL 6 #define FOUT_MMC_PLL 7 /* MUX in CMU_TOP */ #define MOUT_SHARED0_PLL 8 #define MOUT_SHARED1_PLL 9 #define MOUT_SHARED2_PLL 10 #define MOUT_SHARED3_PLL 11 #define MOUT_SHARED4_PLL 12 #define MOUT_SHARED5_PLL 13 #define MOUT_MMC_PLL 14 #define MOUT_CLKCMU_CMU_BOOST 15 #define MOUT_CLKCMU_CMU_CMUREF 16 #define MOUT_CLKCMU_ACC_NOC 17 #define MOUT_CLKCMU_ACC_ORB 18 #define MOUT_CLKCMU_APM_NOC 19 #define MOUT_CLKCMU_AUD_CPU 20 #define MOUT_CLKCMU_AUD_NOC 21 #define MOUT_CLKCMU_CPUCL0_SWITCH 22 #define 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CLK_DOUT_MISC_OTP 3 #define CLK_DOUT_MISC_NOCP 4 #define CLK_DOUT_MISC_OSC_DIV2 5 /* CMU_HSI0 */ #define CLK_MOUT_HSI0_NOC_USER 1 #define CLK_DOUT_HSI0_PCIE_APB 2 /* CMU_HSI1 */ #define CLK_MOUT_HSI1_MMC_CARD_USER 1 #define CLK_MOUT_HSI1_NOC_USER 2 #define CLK_MOUT_HSI1_USBDRD_USER 3 #define CLK_MOUT_HSI1_USBDRD 4 #endif /* _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H */